Votre Processeur Doit Prendre En Charge Les Instructions Avx dernier 2023

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Votre Processeur Doit Prendre En Charge Les Instructions Avx

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Extensions vectorielles avancées (AVX) est un jeu d’instructions d’châssis Intel et AMD x86, vulgarisé par Intel en . Il est accaparé en abordage par les processeurs Intel Sandy Bridge et par les processeurs AMD Bulldozer en 2011. AVX caution de nouvelles fonctionnalités, de nouvelles instructions et un récent souscription de transcodage » VEXER « .

AVX2 étend la grand nombre des commandes SSE et AVX 128 bits à 256 bits. Il est accaparé en abordage par les processeurs Intel Haswell en 2013 et par les processeurs AMD Excavator en 2015.

AVX-512 étend le foule de registres SIMD à 32 et les agrandit à 512 bits. Il utilise un récent transcodage utilisant le Préfixe EVEX consacré par Intel en . Les élémentaires processeurs qui le supportent sont les Knights Landing.

Extensions vectorielles avancées

Schéma d’expansion de calendrier AVX-512 (ZMM0-ZMM31) dans le calendrier AVX (YMM0-YMM15) et SSE (XMM0-XMM15)
511 256 255 128 127
ZMM0 YMM0 XMM0
ZMM1 YMM1 XMM1
ZMM2 YMM2 XMM2
ZMM3 YMM3 XMM3
ZMM4 YMM4 XMM4
ZMM5 YMM5 XMM5
ZMM6 YMM6 XMM6
ZMM7 YMM7 XMM7
ZMM8 YMM8 XMM8
ZMM9 YMM9 XMM9
ZMM10 YMM10 XMM10
ZMM11 YMM11 XMM11
ZMM12 YMM12 XMM12
ZMM13 YMM13 XMM13
ZMM14 YMM14 XMM14
ZMM15 YMM15 XMM15
ZMM16 YMM16 XMM16
ZMM17 YMM17 XMM17
ZMM18 YMM18 XMM18
ZMM19 YMM19 XMM19
ZMM20 YMM20 XMM20
ZMM21 YMM21 XMM21
ZMM22 YMM22 XMM22
ZMM23 YMM23 XMM23
ZMM24 YMM24 XMM24
ZMM25 YMM25 XMM25
ZMM26 YMM26 XMM26
ZMM27 YMM27 XMM27
ZMM28 YMM28 XMM28
ZMM29 YMM29 XMM29
ZMM30 YMM30 XMM30
ZMM31 YMM31 XMM31

La taille des registres SIMD est inanimée de 128 bits à 256 bits, en renommant les registres XMM0-XMM7 en YMM0-YMM7 en coïncidence 32 bits et en ajoutant 8 registres YMM8-YMM15 en coïncidence 64 bits. Sur les processeurs envahissant en abordage AVX, les instructions SSE (qui fonctionnaient avant sur des registres XMM 128 bits) peuvent entité étendues à l’compère du suffixe VEX (à cause) dans avancer sur les 128 bits inférieurs des registres YMM.

AVX grappin un modèle d’certificat SIMD à triade opérandes, à cause auxquelles le calendrier de vivacité est perceptible des règle opérandes montée. Par idée, une certificat SSE emblématique à règle opérandes de la variété A = A + B devrait noter sur l’opérande A dans ranger le aboutissant. AVX est passible de classer les opérandes montée en utilisant un opérande de vivacité accidenté, via la variété C=A+B. Le modèle SIMD à triade opérandes d’AVX est barrière aux registres YMM et n’inclut pas d’certificat lorsque des registres à contact mondial (par idée EAX).

Le récent souscription de transcodage VEX grappin une révélation association de préfixes de arrêté qui élargit l’doline d’opcode, permettant aux instructions d’bien puis de règle opérandes, et permet aux registres SIMD d’maltraiter des vecteurs de puis de 128 bits. Le suffixe VEX peut de même entité géré sur les anciennes instructions SSE en à eux donnant une variété à triade opérandes et en à eux permettant d’interférer puis heureusement lorsque les instructions AVX sauf obligatoirement maltraiter VZEROUPPER et ZEROALL.

Les instructions AVX prennent en abordage les capacités 128 bits et 256 bits. Les versions 128 bits peuvent entité utiles dans bonifier l’postdaté arrêté sauf bien défaut d’précipiter la vectorisation et dans refuser la sanction du ardeur de SSE à AVX. Ce coïncidence est tantôt pris AVX-128.

applications

  • Convient aux pierre intensifs en virgule évasive à cause les applications multimédias, scientifiques et financières (les travaux sur les tous sont attendues à cause une expansion ultérieure).
  • Parallélisme et élocution accrus à cause les pierre SIMD en virgule évasive.
  • Charge de calendrier réduite miséricorde à des instructions non destructives.
  • Améliore les performances du RAID package inférieurement Linux (AVX2 indispensable, AVX ne suffit pas).
  • Prime95 / MPrime, et le package GIMPS qui a trouvé le puis étendu foule aîné à maintenant, utilisent les instructions AVX depuis la état 27.x.

Extensions vectorielles avancées 2

Advanced Vector Extensions 2 (AVX2), de même extraordinaire inférieurement le nom de nouvelles instructions Haswell, sont une expansion du jeu d’instructions AVX grappin à cause l’châssis Haswell. AVX2 supporte spécialement :

  • expansion de la grand nombre des instructions AVX 128 bits à des tous 256 bits,
  • encaissement de possibilité en montré 32 ou 64 bits non contiguës,
  • rapporter ou brocanter des possibilité là-dedans hétéroclites mots de 128 bits,
  • le diffraction rigide ou dilemme des éléments lorsque une portée de diffraction par agençant.

Nouvelles consignes

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La interprétation de cet comptoir ou de cette élément doit entité ordre ().

Le sens est raide à observer en apologie d’fautes de interprétation, qui peuvent entité dues à l’diplomatie d’un package de interprétation algèbre. Discutez des domaines à bonifier sur la gamin de bataille ou modifiez l’comptoir.

Instruction La examen
VBROADCASTSS,
VBROADCASTSD,
VBROADCASTF128
Copie un foule aboulique 32 bits (accessible adresse), 64 bits (équivoque adresse) ou 128 bits d’un opérande montré alentours entiers les éléments d’un calendrier vectoriel XMM (128 bits) ou YMM (256 bits) .
VINSERTI128 Remplace la chope inférieure ou la chope abbesse d’un calendrier YMM 256 bits par la portée d’un opérande montée 128 bits. L’autre chope du calendrier YMM 256 bits, considérée, est inchangée.
VEXTRACTF128 Extrait la chope inférieure ou la chope abbesse d’un calendrier YMM 256 bits et complément cette portée à cause un opérande de vivacité 128 bits.
VMASKMOVPS,
VMASKMOVPD
Lit conditionnellement n’importe combien d’éléments d’un opérande de montré vectorielle SIMD à cause un calendrier de vivacité, laissant les éléments vectoriels restants tapés « non lus » et mettant les éléments correspondants à cause le calendrier de vivacité à caducité. En interprétation, l’alphabet conditionnelle d’un foule neutre d’éléments d’un opérande de calendrier vectoriel SIMD à cause un opérande de montré vectorielle dépôt les éléments restants de l’opérande de montré inchangés.

Sur l’châssis du microprocesseur AMD Jaguar, cette certificat lorsque un opérande montée montré prend puis de 300 cycles d’propulsion avec le mascarade est à caducité, à laquelle cas l’certificat ne devrait babiole compléter. Cela semble entité un disparition de perpétration.

VPERMILPS,
VPERMILPD
Inline permute et serti les éléments vectoriels d’un opérande d’accréditation 32 bits ou 64 bits. Ces instructions en arête de 256 bits fonctionnent sur les 256 bits intégraux lorsque sont constituées de règle blocs de 128 bits hétérogènes, de genre qu’il ne peut y bien de aloi là-dedans ces règle blocs.
VPERM2F128 Réassemble les quatre éléments vectoriels 128 bits de règle opérandes montée 256 bits en un opérande vivacité 256 bits, lorsque une immortelle instantanément praticable environ trieur.
VZEROALL Met à caducité entiers les registres YMM et les alêne « inutilisés ». Cette certificat est utilisée avec de la succession là-dedans les modes 128 bits et 256 bits.
VZEROUPPER Efface la chope abbesse de l’attirail des registres YMM (bits les puis significatifs). Cette certificat est utilisée avec de la succession là-dedans les modes 128 bits et 256 bits.
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Processeurs envahissant en abordage AVX

  • Intel
    • Processeur Sandy Bridge, Q1 2011
    • Processeur Sandy Bridge E, Q4 2011
    • Processeur Ivy Bridge, Q1 2012
    • Processeur Ivy Bridge E, Q3 2013
    • Processeur Haswell, Q2 2013, AVX2 complément
    • Processeur Haswell, Q3 2014
    • Processeur Broadwell, Q4 2014
    • Processeur Broadwell E, rituel en 2016
    • Processeur Skylake, Q3 2015
    • Processeur Kaby Lake, T3 2016
    • Processeur Cannon Lake, T2 2018
  • DMLA :
    • Processeurs basés sur pelle, Q4 2011
    • Processeurs basés sur Piledriver, Q4 2012
    • Processeurs basés sur Steamroller, Q1 2014
    • Processeurs basés sur bineuse, Q3 2015
    • Processeurs basés sur Jaguar
    • Processeurs basés sur Puma
    • Processeurs basés sur Zen (processeurs Ryzen), Q1 2017, AVX2 complément
    • Processeurs basés sur Zen 2, Q3 2019
    • Processeurs basés sur Zen 3, Q4 2020

Les problèmes liés à la accord là-dedans les mouvements processeurs Intel et AMD sont abordés à cause le jeu d’instructions XOP.[pas clair]

Prise en abordage des compilateurs et des assembleurs

Le assembleur GCC direct le appuie-bras AVX à abruptement de la état 4.6 (puis si la état 4.3 direct incomplètement AVX), Intel Suite l’direct à abruptement de la état 11.1, le assembleur Visual Studio l’direct à abruptement de la état 2010/2012, le assembleur Open64 état 4.5.1 le supporte si l’représentant -mavx est activé, PathScale prend de même en abordage AVX si l’représentant -mavx aussi que Vector Pascal (à cause) via l’représentant -cpuAVX32.

Free Pascal supporte AVX et AVX2 depuis la état 2.7.1 lorsque les paramètres -CfAVX et -CfAVX2.

D’autres assembleurs semblables que NASM, MASM VS2010, Yasm, FASM, MSNA et JWASM prennent en abordage AVX.

Système trader

Version des systèmes d’délire à abruptement auxquels le jeu d’instructions AVX est accaparé en abordage.

  • Apple OS X : aggiornamento 10.6.8 (Snow Leopard) publiée le .
  • Linux : accaparé en abordage depuis la état 2.6.30 du foyer, publiée le .
  • Windows : Windows 7 SP1 et Windows Server 2008 R2 SP1, Windows 8, Windows Server 2008 R2 SP1 lorsque Hyper-V nécessite un rectificatif dans digérer en abordage AMD AVX (séries Opteron 6200 et 4200), KB2568088.
  • FreeBSD à cause un raccord vulgarisé le qui voyait admis à cause la état installé 9.1.
  • Prise en abordage de DragonFly BSD réception 2013.
  • OpenBSD complément sur .
  • Mise à aération Solaris 10 10 et Solaris 11.

Références

  • (à cause) Cet comptoir est incomplètement ou nettement enlevé de l’comptoir de Wikipédia en anglo-saxon introduction « Extensions vectorielles avancées » (hisser nomenclature des auteurs).
  • icône décorative Portail de récréations vidéofréquence
  • icône décorative portique télétraitement

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Vidéo sur Votre Processeur Doit Prendre En Charge Les Instructions Avx

Your CPU does not appuie-bras AVX certificat set Error in Xenia

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Source : fr.wikipedia.org

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